Uma arquitetura de um coprocessador criptogrÃfico para o algoritmo Advanced Encryption Standard.

AUTOR(ES)

Zigiotto, Anderson Cattelan

DATA DE PUBLICAÇÃO

2002

RESUMO

O processo de seleÃÃo de um novo padrÃo para criptografia de dados promovido pelo governo norte-americano, denominado Advanced Encryption Standard - AES, resultou na escolha do algoritmo Rijndael. Este cifrador trabalha com blocos de 128 bits e chave criptogrÃfica de 128, 192 ou 256 bits. Espera-se que este novo padrÃo seja amplamente adotado pela iniciativa privada, substituindo o Data Encryption Standard - DES - a mÃdio prazo. Neste trabalho à proposta uma arquitetura de um coprocessador dedicado para executar as funÃÃes de cifragem e decifragem de acordo com a norma AES, com chave criptogrÃfica de 128 bits. O circuito foi implementado em um dispositivo lÃgico reconfigurÃvel do tipo Field Programmable Gate Array - FPGA. A arquitetura proposta foi projetada com a finalidade de reduzir a quantidade de recursos utilizados, de forma a ser implementada em um dispositivo de mÃdia densidade e baixo custo. Para a etapa de sÃntese foi utilizado um dispositivo Altera ACEX 1K50. O circuito sintetizado utiliza 1984 elementos lÃgicos e 6 blocos de memÃria embarcada, atingindo uma taxa de cifragem estimada de 91,8 megabits por segundo. O funcionamento do coprocessador foi comprovado atravÃs de teste funcional, utilizando os vetores de teste fornecidos pela norma.

ASSUNTO(S)

programaÃÃo lÃgica sistemas digitais vhdl (linguagem de programaÃÃo) criptologia criptografia circuitos digitais arquitetura (computadores) seguranÃa da informaÃÃo de computadores

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