Microprocessor
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1. Optical sorting technology for waste management from the Boukhadra iron ore mine (NE Algeria)
Abstract Mining processes in the iron ore mine of Boukhadra, Tebessa (NE Algeria) generated thousands of tons of mining wastes every year, which represents a real threat to the environment, leading to hazardous effects for the resident population of the region. The aim of this study is the selective sorting of the Boukhadra mining wastes for valorization. Th
REM - International Engineering Journal. Publicado em: 2022
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2. Concomitant production of two proteases and alpha-amylase by a novel strain of Bacillus subtilis in a microprocessor controlled bioreactor
We describe the simultaneous production of Bacillus subtilis based proteases and alpha amylase using a computer controlled laboratory scale 7.5 L batch bioreactor. The present strain is the first to be reported that concomitantly produces these two industrially important enzymes. The growth and sporulation of Bacillus subtilis was monitored and maximum produ
Braz. J. Microbiol.. Publicado em: 2012-09
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3. Power Laws na modelagem de caches de microprocessadores. / Power Laws on the modeling of caches of microprocessors.
Power Laws são leis estatísticas que permeiam os mais variados campos do conhecimento humano tais como Biologia, Sociologia, Geografia, Linguística, Astronomia, entre outros, e que têm como característica mais importante a disparidade entre os elementos causadores, ou seja, alguns poucos elementos são responsáveis pela grande maioria dos efeitos. Exem
IBICT - Instituto Brasileiro de Informação em Ciência e Tecnologia. Publicado em: 10/06/2011
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4. Data processing section for microprocessor-like integrated circuits
A methodology for the design of complex logic VLSI circuits is presented. The target application is deseribed by an algorithm from which the structures of the control section and the data processing section of the integrated circuit are inferred. The Srchltectural aspects are discussed and a model is proposed. A set of functional cells is then presented whic
Publicado em: 2011
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5. Desenvolvimento de um leitor digital de absorbância microprocessado / SILVA, A. J. Development of a digital reader Absorbance microprocessor . Dissertation (Master) Faculdade de Filosofia, Ciências e Letras de Ribeirão Preto, Universidade de São Paulo, Ribeirão Preto - SP, 2011.
O espectrofotômetro, aparelho muito utilizado para realizar leituras de absorbância e/ou transmitância de amostras laboratoriais, pode ser aplicado para a realização de leituras do dosímetro químico Fricke Xilenol Gel. Este aparelho, por possuir componentes eletrônicos avançados e ser importado, apresenta um custo elevado e acaba muitas vezes se tor
Publicado em: 2011
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6. Teste integrado de software e hardware : reusando casos de teste de software em teste de microprocessadores / Integrated test of software and hardware: reusing software test cases to test of microprocessor
Sistemas embarcados estão mais complexos e são cada vez mais utilizados em contextos que exigem muitos recursos computacionais. Isso significa que o hardware embarcado pode ser composto por vários processadores, memórias, partes reconfiguráveis e ASIPs integrados em um único silício. Adicionalmente, o software embarcados pode conter muitas rotinas de
Publicado em: 2010
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7. Conception d'un circuit integre arbitre de bus de communication multiprotocoles : ABC M
O estudo de diferentes "bus" de comunicação paralela utilizados em arquiteturas multi-microprocesssodores ("bus" das estruturas SM 90, MULTIBUS e VME), assim que suas técnicas de arbitragem respectivas, nos permitiram de conduzir nosso trabalho sobre o estudo de compatibilidade do circuito integrado arbitro de bus ABC 90 da estrutura SM 90 (cujas funçõe
Publicado em: 2010
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8. IMPLEMENTAÇÃO DE ARQUITETURAS DE PILHA UDP/IP EM HARDWARE RECONFIGURÁVEL BASEADO NO DESEMPENHO DE VAZÃO, LATÊNCIA E TAXA DE PERDA DE QUADROS / IMPLEMENTATION OF UDP/IP STACK ARCHITECTURES IN RECONFIGURABLE HARDWARE BASED ON THROUGHPUT, LATENCY AND FRAME LOSS RATE PERFORMANCE
This work presents the implementation of three architectures of UDP/IP network stack in reconfigurable hardware. Also, presents the development of a Tester based on the RFC 2544 methodology and implemented it in FPGA. This Tester was used to obtain the throughput, latency and frame loss rate results. The performance of the project shows, in average, throughp
Publicado em: 2010
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9. Clock mesh optimization / Otimização de malhas de relógio
Clock meshes are a suitable clock network architecture for reliably distributing the clock signal under process and environmental variations. This property becomes very important in the deep sub-micron technology where variations play a main role. The clock mesh reliability is due to redundant paths connecting clock buffers to clock sinks, so that variations
IBICT - Instituto Brasileiro de Informação em Ciência e Tecnologia. Publicado em: 2010
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10. Risco : microprocessador RISC CMOS de 32 bits / Risco - a 32-bit CMOS RISC microprocessor
Este trabalho apresenta o estudo, a definição e a simulação elétrica e lógica de um microprocessador CMOS de 32 bits, com arquitetura tipo RISC - o Risco. Dentre as principais características do Risco destacam-se: dados, instruções e endereços são palavras de 32 bits; a unidade de endereçamento é a palavra, permitindo um acesso a 4 Giga palavras
Publicado em: 2010
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11. A five-year hedonic price breakdown for desktop personal computer attributes in Brazil
The purpose of this article is to identify the attributes that discriminate the prices of personal desktop computers. We employ the hedonic price method in evaluating such characteristics. This approach allows market prices to be expressed as a function, a set of attributes present in the products and services offered. Prices and characteristics of up to 3,7
BAR - Brazilian Administration Review. Publicado em: 2009-09
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12. Analysis and optimization of mesh-based clock distribution architectures / Analise e otimização de arquiteturas de relógio do tipo malha
Variações ambientais e de processo representam um grande desafio a ser vencido pelas redes de distribuição de relógio. O efeito das variações nos atrasos da rede de distribuição de relógio não pode ser previsto com precisão e portanto não podem ser diretamente considerados no projeto das redes de distribuição de relógio. Estruturas baseadas e
Publicado em: 2009